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ディジタルメディアプロフェッショナル社IP
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ザイリンクスアプリケーションノート

ディジタルメディアプロフェッショナル社
3D/2DグラフィックスIPコア 製品

PICA®200 for FPGA
SMAPH®-F for FPGA
PICA®200 for FPGA Vertex-6 Evaluation Kit
SMAPH®-F for FPGA Vertex-6 Evaluation Kit

ディジタルメディアプロフェッショナル社

<PICA®200 for FPGA 3DグラフィックスIP>

PICA200 for FPGA は、アミューズメント機器などで多くの実績をもつ OpenGL ES 1.1 対応 3D グラフィックス IP コア PICA200 をベースに、量産向け FPGA 実装に最適化した業界初のリアルタイム フル 3D グラフィックス IP コアです。

特徴

●産業機器、医療機器、航空宇宙関連機器などのアプリケーションに最適
●OpenGLES1.1対応
●リアルタイム3Dグラフィックスによる高度なHMI
 (HumanMachine Interface) を実現
●最大XGA解像度(1024×768ピクセル)
●毎秒300万ポリゴン以上(50MHz動作時)
●1ピクセル/クロックでの高速レンダリングを実現

主要機能

■描画機能
  −OpenGL® ES1.1対応
  −T&L処理(頂点プロセッサー内蔵)
  −テクスチャマッピング
    ・マルチテクスチャー数:2
    ・バイリニアフィルター
    ・mipマップ
    ・レンダート・ツー・テクスチャ
  −アルファブレンディング
  −アンチエリアス付き高速ライン描画
  −フルシーン・アンチエリアシング(2x1, 2x2)
  −ピクセルフォーマット:RGBA4444, RGB565, RGBA5551, RGBA8888
  −8bitステンシルバッファ
  −24bitデプスバッファ
  −シングル・ダブル・トリプル・フレームバッファ対応

■描画性能
  −頂点性能:最大3.8M polygons/sec (50MHzの場合)
  −ピクセル性能:最大50M pixels/sec (50MHzの場合)

■サポートFPGA
  −Virtex-5 LX FPGA
  −Virtex-6 LXT/SXT/HXT FPGA

■提供形態
  −ドキュメント:テクニカルリファレンスマニュアル
  −デザインファイル:NGCネットリスト、 Xilinx ISE制約ファイル、
              シミュレーション用暗号化RTL、テストベンチ/ベクター
  −ソフトウエア:OpenGLES1.1ライブラリ、サンプルプログラム

PICA200 for FPGA 詳細
http://www.dmprof.com/products/pica200_fpga/ (DMP社 Webサイトへリンク)


SMAPH®-F for FPGA 2D ベクター グラフィックス IPコア

SMAPH-F for FPGA は、車載機器やコンシューマエレクトロニクス向けアプリケーションプロセッサなどで実績をもつOpenVG 1.1 対応ベクターグラフィックスIPコアSMAPH-Fを、量産向け FPGA 実装に最適化した業界初のベクターグラフィックス IP コアです。

特徴

●デジタル家電、車載表示装置、モバイル機器などの広範囲な組込み機器のディスプレイ用アプリケーションに最適
●OpenVG1.1対応
●Adobe® Flash® Lite™やSVGコンテンツを高速・高品質描画
●CPUのみでベクターグラフィックスを描画した場合に比べて大幅な高速化を実現

主要機能

■対応API : OpenVG 1.1 およびDMP拡張API
■フレームバッファ:最大4088×4088ピクセル ■ピクセルフォーマット:RGBA4444, RGB565, RGBA5551, RGBA8888, ARGB4444, ARGB1555, ARGB8888
■シングル/ダブル/トリプル・バッファ
■Path, Stroke描画
■最大4×4マルチサンプリング・アンチエイリアシング
■バイリニアフィルタリング
■ETC圧縮テクスチャ
■グラデーション拡張機能
■パスセットアップ性能:最大5.5M path/sec (166MHzの場合)
■ピクセル性能:最大166M pixel/sec (166MHzの場合)

SMAP®-F for FPGA  詳細
http://www.dmprof.com/products/smaph_f/(DMP社 Webサイトへリンク)


PICA®200 for FPGA Virtex-6 Evaluation Kit

ザイリンクスの Virtex®-6 ファミリ FPGA を搭載した 3D/2D グラフィックス システム開発に最適な FPGA 開発評価ボード上に PICA®200 for FPGA 3DグラフィックスIPを統合したキット

SMAPH®-F for FPGA Virtex-6 Evaluation Kit

SMAPH-F for FPGA(FPGA向け実装に最適化されたSMAPH-F)のIPライセ ンスとザイ リンクスの Virtex®-6 ファミリ FPGA を搭載した開発評価ボードをセットで提供します。
(開発評価プラットフォームは PICA®200 for FPGA Virtex-6 Evaluation Kitに含まれるものと同一)

■ PICA®200 for FPGA Virtex-6 Evaluation Kit および SMAPH®-F for FPGA Virtex-6 Evaluation Kit に含まれる開発評価ボード
・搭載 FPGA : ザイリンク社 XC6VLX760-2FFG1760C、XC6VLX550T-2FFG1759C
・コンフィギュレーション : micro SD カード (XC3S700AN デバイス使用)
・PCI Express x4 Gen1 対応
・FMC コネクタ (High Pin Count) X 2
・DDR3 SO-DIMM (1GB) X 2
・HDMI インターフェイス (TX のみ)
・LCD コネクタ (TX のみ)
・Push スイッチ、DIP スイッチ、LED、ピンヘッダ

■ 開発評価ボード概観図

                            


ザイリンクス社 プレスリリース (ザイリンクス Webサイトへリンク)

ディジタルメディアプロフェッショナル社 プレスリリース (DMP Webサイトへリンク)


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●デモ随時受付中!お気軽にお問合せください。





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ノースウエストロジック社 IPコア製品

ノースウエストロジック社は、1995年に米国オレゴン州ビーバートンで設立、FPGAやASIC向けに高性能で使いやすいIPコア製品を提供しています。
メモリコントローラ、PCI Express、PCI-X、PCIやMIPIなどのIPコア製品がございます。

samplifyロゴ

<ノースウエストロジック社 IPコア製品の特徴>

  • High performance 高速クロックや高速スループットをサポート
  • Easy to use シンプルなユーザインタフェースと設定など
  • シリコン上での動作検証
  • 機能検証スイートの提供
  • ザイリンクス社 Virtex-5 FXT/LXT/SXT全ファミリー、およびASICのサポート
  • トップレベルの技術サポート
  • カスタム、およびインテグレーションサービス

PCI Expressソリューション(ノースウエストロジック社 WEBサイトへリンク)

メモリインターフェースソリューション(ノースウエストロジック社 WEBサイトへリンク)


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ノースウエストロジック社 WEBサイトへリンク





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サンプリファイシステムズ社IP

ロスレス(可逆圧縮)とリアルタイム性の両方を兼ね備えた新しい圧縮アルゴリズム、ロスレスリアルタイム圧縮・伸張技術「Prism™

samplifyロゴ

サンプリファイシステムズ社のロスレスリアルタイム圧縮・伸張技術 「Prism™」は、CT(コンピュータ断層撮影装置)・ATE(自動試験装置)・ワイヤレス基地局などの医療機器・産業機器・通信インフラ向けアプリケーションにフォーカスし、ロスレス(可逆圧縮)とリアルタイム性の両方を兼ね備えた新しい圧縮アルゴリズムです。

本技術を用いることにより、既存のハードウェアを活かしながら、さらなる大容量データ伝送を可能にします。 また、次世代機器開発では、部品点数の削減や安価な部品を利用する可能性が広がり、発熱、消費電力、製品コストの削減を実現します。さらに、データの劣化が許されない分野に高いリアルタイム性をもったソリューションを提供します。連続性のあるデータの特徴をとらえて圧縮する「Prism™」は、アプリケーションの依存性が低いため、多様なアプリケーションへの対応が可能です。

<IPの基本情報>

ブロック図

Parameter(Virtex-5 FPGA)

Compression

Decompression

Units

Clock to Clock delay(min) 4.95 5.05 ns
Logic Elements 1009 982 Slices
BlockRAM/FIFO 3 3 -
BlockRAM 5 5 18k
DSP48E(18‐bit inputs) 2 2 MACs

圧縮率の事前確認を行うアナライズソフトウェアをご用意しています。(東京エレクトロンデバイスWebサイトへリンク)

サンプリファイシステムズ社 A/Dコンバータ「SAM1600ファミリ」


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サンプリファイシステムズ社 WEBサイトへリンク





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アイウェーブ・ジャパン社「iW -86SOC」

iW -86SOCは、NECV53CPU及びインテル80186CPUと互換があり、周辺チップの機能も含めてSpartan-3 GenerationシリーズのFPGAで実現したIP製品です。


基本仕様

  • iW -86 CPUコア
    • バスインタフェースユニット
    • バス競合調停ユニット
    • ウエイト制御ユニット
    • リフレッシュコントロールユニット
  • マルチプロトコルシリアルコントローラ(Z8530及びuPD72001相当)
  • 8254プログラマブルタイマー
  • PCI ホスト、マスター、ターゲットコントローラとFPGA内メモリ
  • 周辺入出力、メモリバスインタフェース
  • CPUオンチップ周辺回路
  • プログラマブル16ビットタイマ(8254互換)
  • シリアルコントローラ(8251互換)
  • 割込コントローラ(8259互換)
  • DMAコントローラ(8237互換)

  • iW -86SOC詳細情報(アイウェーブ・ジャパン社WEBサイトへリンク)

コアの特徴

  • 80186命令互換
  • 部品コストの削減
  • クロックを上げることでパフォーマンスが向上
  • 長期安定供給が可能

ブロック図





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アイウェーブ・ジャパン社 iWaveのIP製品一覧





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デナリソフトウエア社と共同開発「DDR2 SDRAM PHYデザイン」

DFI(DDR PHY Interface)に準拠したVirtex-5対応「DDR2 SDRAM PHYデザイン」でLSIの開発期間の短縮が可能に


この度、デナリソフトウエア社と東京エレクトロン デバイスは、DDRメモリコントローラとPHYの標準インタフェースであるDDR PHY Interface (DFI)に準拠した、Virtex-5上で動作する「DDR2 SDRAM PHYデザイン」を共同開発しました。 このDDR2 SDRAM PHYデザインは、DDRの特殊なメモリコントローラ設計における多大な開発やインテグレーション作業を短縮することができ、高速DDR2インタフェースを用いたLSIの開発が短期間にかつリスクを軽減して実現することができます。
また、このDDR2 SDRAM PHYと、多数のLSIに実装実績のあるデナリソフトウエア社のメモリコントローラ設計IP「Databahn」、東京エレクトロン デバイス「Virtex-5マルチ・アプリケーション評価プラットフォーム(TB-5V-LX110/220/330-DDR2)」を組み合わせることにより、効率のよい設計・開発が実現可能です。

Databahn詳細(デナリソフトウエア社Webサイトへリンク)
Virtex-5マルチ・アプリケーション評価プラットフォーム(TB-5V-LX110/220/330-DDR2)詳細


DFI(DDR PHYインタフェース)について

DFI仕様の目的は、コストを削減し、市場投入までの時間を短縮するために、メモリ・コントローラのロジックとDDR PHYインタフェース間の共通のインタフェースを定義し、メモリ・システムを構成する個々のコンポーネントを再利用できる可能性を高めることです。DFI仕様は、ARM、Denali、Intel、Rambus、Samsung、およびSynopsysを含む半導体、IP、および電子機器設計自動化(EDA)業界で認められた有力企業の献身的専門家によって開発されています。 DFI仕様では、統合コストを削減しながら性能とデータ処理スループットの効率を高めることを目的として、メモリ・コントローラのロジックとDDR PHYインターフェイス間のインターフェイス・プロトコルが定義されています。DFI仕様レビジョン1.0は、2007年1月に製品開発目的で発表されました。詳細については、http://www.ddr-phy.orgをご覧ください。



DFIのメリット


○ メモリコントローラ設計作業の大幅削減
  • 開発やインテグレーションなどの煩雑な作業からの解放
  • 検証作業の切り分けが容易
  • 市販のDFI対応IPの利用が可能

○ ASIC/FPGAベンダフリー化
  • ベンダ選択肢の増加
  • ベンダ固有のインテグレーションの作業が軽減
  • 設計再利用時の負荷軽減

○ FPGAプロトタイプ⇒ASICへのシームレスな移行
  • 設計の加速
  • リスク軽減の実現

DDR2 SDRAM PHYデザイン(Verilog-HDLソースコード)
TED Support Webにて公開しています。


デナリソフトウエア社 WEBサイトへリンク





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アピカル・リミテッド IP

ザイリンクスFPGAで実現できるリアルタイム・ダイナミックレンジ補正技術 「iridix」と高性能ノイズリダクション技術


アピカル社の画像処理技術 iridix は、人間の網膜の動きを模倣したアルゴリズムによるダイナミックレンジ補正技術をIPとして提供しています。撮影現場で肉眼で目にしていたイメージに限りなく近いアウトプットを、ダイナミックに出力します。iridix は、フレーム内のエリアを参照しながらピクセル単位でダイナミックに輝度を変えます。それにより、どのようなシーンでもどのような鑑賞環境下でも、最も自然なイメージを再現する事が出来ます。

iridix 及び ノイズリダクション IPコア アプリケーション適用例:

カメラ アプリケーション:デジタルカメラ、ビデオカメラ、セキュリティカメラ  ディスプレイアプリケーション:フラットパネルディスプレイ、モバイル端末、プロジェクタ 等

iridix のダイナミック補正とは



iridix 特徴

  • リアルタイムに、アダプティブに、ピクセル単位でダイナミックレンジを補正
  • SDTV及びHDTV(720p,1080i)サポート
  • 16メガピクセルまでの静止画サポート
  • サポート映像フォーマット
    • - 4:2:2 YUV ITU656 (8/10-bit interleaved,16/20-bit non-interleaved)
    • - 4:4:4 YCrCb (24/30-bit)
    • - 4:4:4 RGB(24/30-bit)
  • I2Cパラメータコントローラ
  • リアルタイムビデオエンハンスメント/高品質画像/小さなコアフレームメモリ不要
  • サポートデバイス:ザイリンクス Spartan-3E/3, Virtex-4/II

iridix と一般的なガンマ補正の違い



典型的なディスプレイパイプラインと iridix 処理



Spartan-3A/AN/A DSP搭載評価ボードにおける iridix とノイズリダクションの評価方法例




Spartan-3Eディスプレイ・ソリューション・ボード詳細

ノイズリダクションについて

アピカル社は、2種類の高度なノイズリダクションアルゴリズムをザイリンクスFPGA向けに提供しています。 「テンポラル・ノイズリダクション」は「3次元ノイズリダクション」としても知られるもので、再生ビデオからオブジェクトの 動きを検出・分析し、動きによるブラーリングを出さないままでランダムノイズを最大限に抑える為に、局地的にノイズ を平均化します。
「インフレーム・ノイズリダクション」は、動画の各フレーム毎・あるいは静止画に対し、適応性のあるノンリニアなフィル タリングをかけます。ノイズのあるエリアをスムージングしながらも、エッジやテキスチャは保持することができる高度なアルゴリズムです。 これらのモジュールは、独立しても連携させても使用できます。 また、高いS/N比で最高のダイナミックレンジ圧縮を達成するために、iridix の前処理として使用可能です。カメラノイズ、及び圧縮ノイズに適しています。

インフレーム・ノイズリダクション効果事例



テンポラル・ノイズリダクションの特徴

  • 動きのある映像状態に適応
  • 動画10フレームまでの局地的ノイズの平均化
  • インターレースあるいはプログレッシブに対応
  • 外部メモリ必要
  • フレーム遅延なし
  • 高速DDR/DDR2 メモリコントローラ内蔵

インフレーム・ノイズリダクションの特徴

  • 高度なノンリニアのフィルタリング
  • シャープネスとテクスチャを保持
  • 輝度ノイズとカラーノイズを区別して処理
  • 外部メモリ不要

ノイズリダクション サポートフォーマット&IF

  • SDTV及びHDTV(720p,1080i)サポート
  • 16メガピクセルまでの静止画サポート(インフレームのみ)
  • サポート映像フォーマット
    • - 4:2:2 YUV ITU656 (8/10-bit interleaved,16/20-bit non-interleaved)
    • - 4:4:4 YCrCb (24/30-bit)
    • - 4:4:4 RGB(24/30-bit)
  • I2Cパラメータコントローラ

ザイリンクスSpartan-3E インプリメンテーション情報




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アイベックステクノロジー社 IP

MPEG2 デコーダ IP

MPEG2 VideoデコーダIPは、FPGA1チップでHDTVに対応でき、並列度を高めることで16K×16Kの大画面出力や、HD10倍速等の特殊なニーズにもお答えします。


特徴
  • 豊富な採用実績
  • ハードワイヤード・ロジック
  • 低周波数動作により、FPGA 1 チップでHD TV クラスのデコードを実現
  • スケーラブル・アーキテクチャにより、性能を容易にアップすることが可能
  • MPEG2 規格通りに忠実に演算(十分な演算精度を保証)
  • FPGA により、アーキテクチャを実証済み
  • エラー耐性
  • 最大入力ビットレート600Mbps

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MPEG2 エンコーダ IP

MPEG2 エンコーダ IPは、アイベックステクノロジー社 MPEG2 エンコーダをチューニングし、超低遅延で映像をエンコードします。MPEG2 デコーダとの組合わせにより、コーデック時間8msec以下を実現します


特徴
  • ビデオエンコード機能
    • 対応クロマ・フォーマット: 4:2:2対応
    • 対応ピクチャ・タイプ:イントラ・ピクチャのみ
    • 最大エンコードサイズ: 2047 × 2047 まで
  • 外部メモリ・インタフェース
    • 32bit幅:2系統(ビットストリーム用, YCフレーム・バッファ用)
  • ストリーム出力インタフェース
    • ES出力
  • ホスト・インタフェース
    • アドレス16、データ8、 CS、R/W信号
    • 非同期インタフェース(標準的なCPUバスに接続可能)

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株式会社デザイン・ゲートウェイ

シリアルATA-IP コア (SATA-IIに対応)

シリアルATA(SATA)IPコアは、Serial ATA Revision 2.6に準拠しており、ザイリンクス製Virtex-5, Virtex-6,およびSpartan-6 FPGAで動作するデザインとなっています。
本IPコアはリンク層のみの提供ですが、リファレンスデザインとしてトランスポート層およびザイリンクス社提供3.0Gbps SATA-IIインタフェース用20ビット150MHz RocketIO GTP物理層デザインが用意されており、PHYチップなしでSATA-IIハードディスクとの接続が可能です。


Spartan-6 LXT FPGA 向け 型番: SATA-IP003

Family

Spartan®-6LXT

Example Device

XC6SLX45T-3FGG484C

Fmax (MHz)

227

Slices1

509

IOB2

119

BUFG/BUFGMUX

3

BRAM

2

Mult/DSP48

0

DCM/CMT

1

MGT

1

DesignTools

ISE® 11.4



シリアルATA-IPコア付属のリファレンスデザインは、Xilinx製ML505/506/507およびSP605ボード用にデザインされており、本IPコアの評価およびSATA-IPコアを使用したロジック開発ををすぐに行なうことができます。本SATA-IPをXilinx ML505/ML506/SP605ボード上ですぐに評価できるよう、時間限定版bitファイルを準備しております。
※SP605ボードにSATAインタフェースを拡張する「PCIeSATAx1アダプタボード (型番:AB01-PCIe2SATA)」が別途必要です。


評価版提供中
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TOE-IPコア (TCPオフローディングエンジン) ギガビットイーサネットに対応

TCPオフローディングエンジン(TOE)IPコアは、従来高価なハイエンドCPUを必要とされた複雑なTCP送信処理の一部を、本IPコアにより自動実行することで、低コストプロセッサでTCPの実装を可能とした画期的なソリューションです。 TCP/IPプロトコル処理のうち、高速動作を必要とする機能は全て本IPコアによって自動実行されるため、ホストプロセッサのCPU占有時間を大幅に削減します。リファレンスデザインとして、ザイリンクス社のFPGAに実装し、ホストプロセッサーとしてMicroBlazeを使用した、TCP送信デザインを用意しています。 また、ザイリンクス社製Spartan-3A DSP 1800ボードおよびML506ボード用デモファイルを準備しておりますので、購入前に本コアを実機で評価・お試し頂けます。


SATA-IP001

Family

Virtex®-3A DSP Virtex®-6 LX

Example Device

XC3S1800A-5FFG676C XC6SLX16-2CSG324C

Fmax(MHz)

141 145

Slices

1042 484

IOB

108 108

GCLK

3 3

BRAM

4〜 4〜

Mult/DSP48/E

0 0

DesignTools

ISE® 11.3 ISE® 11.3


TOE-IPコアにより、TCP送信処理のうち負荷が重いものをハードウェア化するため、低コストFPGAおよびプロセッサでも最大900Mbps超、平均800Mbps超の実効転送速度を実現します。
Spartan3A DSP 1800ボードリファレンスデザインでの評価
ホストプロセッサとして、MicroBlaze(クロック62.5MHz)を使用
PCにてデータ受信 MSS 1460バイト


評価版提供中
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BECKHOFF社
EtherCATスレーブIP

TEDは、株式会社ケーメックスが国内総代理店であるBECKHOFF社製のザイリンクス社FPGA向けEtherCATスレーブIPを購入されたお客様向けに技術サポートを提供しており、安心して開発いただける環境をサポートしています。


EtherCAT製品概要

EtherCAT(Ethernet for Control Automation Technology)は突出した能力を持ちながらシンプルな取り扱いが可能という特徴をもった自動制御のためのソリューションです。
EtherCATはEthernetのスター型トポロジをシンプルなライン構造に置き換えます。オプションとしてEtherCATはEthernet環境と混在させるために、伝統的なスイッチングハブを用いた配線も可能です。
マスタ側には特別なインタフェースカードは必要なく、従来のEthernetポートをそのまま使用できます。それゆえにEtherCATは従来コストメリットが無く使用できなかった中小規模の制御システムにも最適なソリューションであり、従来よりもさらに広範囲なアプリケーションに活用できます。

EtherCATの製品特徴

  • 圧倒的な高速性
  • 特殊機器不要
  • シンプルかつ柔軟なネットワークトポロジ
  • TCP/IPとの混在
  • オープンなテクノロジ
    EtherCATテクノロジ・グループ(http://www.ethercat.org/)に加盟すればどのベンダ、ユーザーであってもEtherCATの技術を入手できます。

IP購入と技術サポートフロー

IP購入と技術サポートフロー

BECKHOFF社について

Beckhoff社(ドイツ)はPCベースのオープンな自動制御システムを提供します。
製品単体としてはもちろん、製品同士を組み合わせることにより完全な一つの制御システムとしてシームレスに活用でき、すべてのお客様のニーズにお応えします。Beckhoff社の提供する製品およびシステムソリューションは、既に世界中のあらゆる分野でのアプリケーションに活躍しています。
http://www.beckhoff.se/

株式会社ケーメックスについて

株式会社ケーメックスは、ヨーロッパで培われた高度な技術力と信頼性のある製品をメインに、各国の海外規格を取得した制御部品・配線部品から工業用電気・電子部品、自動制御システム、インダストリアルコンピュータ、周辺機器等を皆様にご提供する専門技術商社です。
http://www.kmecs.com/index.cgi

BECKHOFF IP 製品ラインナップ

株式会社ケーメックス Webサイトにてご確認下さい


BECKHOFF IP お問合せ

株式会社ケーメックス Webサイト お問合せフォーム
http://www.kmecs.com/inquiry/index.html



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